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2.4 差分放大电路
前述基本放大电路仅有一个信号源输入,称为单端输入放大电路。下面将介绍具有两个信号源输入的双端输入放大电路,由于这种电路放大的是两个输入信号的电压之差,故又称差分放大(Differential Amplifier)电路。差分放大电路是一种非常有用的放大器,在许多工程应用中,为了提高系统的抗干扰能力以获取微弱的有用信号,常常以差分放大的形式进行放大。下面以图2-29所示电路为例进行说明。
图2-29a使用的是非差分输出型传感器,假设检测到的信号需要经过一段较长的传输线后进入单端输入放大器进行放大,如果传输过程中受到干扰,使得传输线中的信号出现了一个尖峰,则这个多余的干扰信号会与有用信号一起被放大,这在电子系统中是非常不愿意看到的,如何才能避免呢?图2-29b使用的是差分输出型传感器,它有正、负两个输出端,两输出端的信号之差才是检测信号,如果在传输过程中受到同样的干扰,使得两条传输线同时出现了尖峰,当进入差分放大器后,由于只放大两输入信号之差,因此放大的恰好是检测信号,两条传输线上同时出现的尖峰干扰则被相互抵消了。这种利用差分型传感器与差分放大器进行信号采集的方法在实际电路中获得了广泛应用。
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图2-29 利用差分放大器抑制干扰
a)非差分型传感器与单端输入放大器 b)差分型传感器与差分放大器
2.4.1 共模信号与差模信号
差分放大器的两个输入端上一般为任意信号,记作ui1、ui2。对ui1、ui2可作如下分解:
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分解式中的第一项均为,表示一对大小相等、极性相同的信号,称为共模信号,记作uic,
;分解式中的第二项为
,这是一对大小相等、极性相反的信号,称为差模信号,它们的差值
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恰为两输入信号ui1、ui2之差,称为差模输入电压,记作uid,即uid=ui1-ui2。
显然,差模信号携带着有用信息,是需要被放大的信号;共模信号代表附加在两输入端上的一对无用信号(例如,环境温度变化或外部干扰在两个输入端上产生的影响几乎是相同的,可等效为一对共模信号),对它们不但不需要放大,反而应当加以抑制。设差分放大电路的差模电压放大倍数为Aud,共模电压放大倍数为Auc,根据叠加定理,总输出电压为
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为综合衡量差分放大电路对差模信号的放大能力和对共模信号的抑制能力,定义共模抑制比
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有时也用分贝表示共模抑制比,即
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KCMR越大,表示电路的综合性能越好,理想情况下KCMR→∞。
2.4.2 射极耦合差分放大电路
射极耦合差分放大电路如图2-30a所示,电路由两个完全对称的共射放大电路通过电流源耦合而成,正、负双电源供电。有两个输入端ui1、ui2,若两个输入端都有信号输入,称为双端输入;若只有一端有信号输入,另一端接地,称为单端输入。电路有两个输出端uo1、uo2,若信号从uo1、uo2之间取出,称为双端输出;若只从uo1或uo2输出,称为单端输出。
静态分析时,ui1=ui2=0,直流通路如图2-30b所示。电流源为VT1、VT2提供静态发射极偏置电流,保证VT1、VT2工作在放大区,且
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动态分析时,由于实际电路中的电流源不可能是理想电流源,设其内阻为ro,得到交流通路如图2-30c所示。下面分别讨论对该交流电路分别施加共模信号和差模信号时,电路将如何表现。
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图2-30 射极耦合差分放大电路
a)电路图 b)直流通路 c)交流通路
1.对共模信号的抑制
如图2-31a所示,当ui1=ui2=uic时,称为共模输入。此时晶体管VT1、VT2上的各个交流电流、电压将在Q点的基础上产生等值同向变化,即ib1=ib2,ic1=ic2,uo1=uo2;根据并联原理,将耦合在一起的VT1、VT2拆开时,相当于每个晶体管的发射极都接入了一个阻值为2ro的等效电阻,如图2-31b所示。
双端输出时,假设电路的结构和参数完全对称,则共模电压放大倍数为
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图2-31 射极耦合差分放大电路对共模信号的抑制
a)共模输入方式 b)共模输入时的交流通路
单端输出时,若负载为RL,则共模电压放大倍数
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由式(2-57)可知,ro数值很大时,单端输出的共模电压放大倍数也大大降低。
综上所述,无论是双端输出还是单端输出,差分放大电路的共模放大倍数都很小,对共模信号的抑制作用很强,且ro越大,|Auc1|、|Auc2|就越小;若ro→∞,则Auc1、Auc2趋于零,共模信号将被完全抑制掉。
从图2-31b还可看出,共模输入电阻为
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单端输出时的共模输出电阻为
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2.对差模信号的放大
当两个输入端之间加信号uid时,如图2-32a所示,两个输入端上的实际电压为
![](https://epubservercos.yuewen.com/17AC5F/21122066201628406/epubprivate/OEBPS/Images/67_05.jpg?sign=1739161654-KnGdeBuDAslBYVghYUAp7mx2nujmUlCF-0-a68253468a60af581bc76d305320f9ed)
这是一对差模信号,即ui1=-ui2,相应的输入方式称为差模输入。此时VT1、VT2上的各个交流电流、电压将在Q点的基础上产生等值异向变化,即ib1=-ib2,ic1=-ic2,ie1=-ie2,uo1=-uo2。由于ro上没有交流电压降,故发射极e可视为“交流地”,如图2-32b所示。
由图2-32b可见,双端输出时的差模电压放大倍数为
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单端输出时的差模电压放大倍数为
![](https://epubservercos.yuewen.com/17AC5F/21122066201628406/epubprivate/OEBPS/Images/67_07.jpg?sign=1739161654-DxlrWVrWHtEXzZjucL5COj3wsocapufU-0-df9befdc52d40b17ef2f603c6472bb5e)
![](https://epubservercos.yuewen.com/17AC5F/21122066201628406/epubprivate/OEBPS/Images/68_01.jpg?sign=1739161654-ex8jBOfN1E0jiCjnFtb315SgLJY2K1Nk-0-16b9bbc2dfac1f41a19ed3c27c104246)
图2-32 射极耦合差分放大电路对差模信号的抑制
a)差模输入方式 b)差模输入时的交流通路
由式(2-61)~式(2-63)可以看出,空载时双端输出的差模电压放大倍数相当于单边共射;单端输出的差模电压放大倍数则降为双端输出的一半,且输出电压的极性与信号的取出位置有关。若uo1、uo2之间接有负载电阻RL,如图2-33所示,则RL的中性点相当于交流接地点,每个输出端上接有的等效负载电阻为RL/2,双端输出时的差模电压放大倍数变为
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图2-33 差模放大时双端输出
![](https://epubservercos.yuewen.com/17AC5F/21122066201628406/epubprivate/OEBPS/Images/68_03.jpg?sign=1739161654-jMBLjpcz1aVG5r7QdAoC8AQUteCLrP36-0-0ac3153911ef1c46c1e653a1d7bceed6)
若负载RL接在uo1或uo2端到地之间,则单端输出时的差模电压放大倍数变为
![](https://epubservercos.yuewen.com/17AC5F/21122066201628406/epubprivate/OEBPS/Images/68_04.jpg?sign=1739161654-4UyLcQD7YM7JzRWx69EtBrzLpZo9odv4-0-400e1e59510ead3d1a1d38d10271db7b)
从图2-32b和图2-33还可看出,差模输入方式下的差模输入电阻为
![](https://epubservercos.yuewen.com/17AC5F/21122066201628406/epubprivate/OEBPS/Images/68_05.jpg?sign=1739161654-l7hK8bXwWw3TtcnzkPH9ek2h2R04bzq3-0-9bab3823f6d076ffb25d6cdc56d94c1b)
双端输出时的差模输出电阻为
![](https://epubservercos.yuewen.com/17AC5F/21122066201628406/epubprivate/OEBPS/Images/68_06.jpg?sign=1739161654-NPwqbUWHYz80bWwifTMzeGYCA9rvBqYl-0-721721b47926b5820717286cd11cc8e2)
单端输出时的差模输出电阻为
![](https://epubservercos.yuewen.com/17AC5F/21122066201628406/epubprivate/OEBPS/Images/68_07.jpg?sign=1739161654-3NNcmUfhTt8y2cLwITwepMNhBTKIRpGh-0-a70f82599430fd8f3874a2ae0f962b85)
2.4.3 源极耦合差分放大电路
源极耦合差分放大电路输入电阻高、输入偏置电流极小,其电路结构、工作原理和分析方法与射极耦合差分放大电路基本相同,只需采用场效应晶体管的小信号等效模型分析计算即可。
【例2-7】 场效应晶体管差分放大电路如图2-34a所示。已知RD=10 kΩ,RS=20 kΩ,RL=15 kΩ,场效应晶体管的gm=0.9 mS,试求单端输出时的差模电压放大倍数Aud、共模电压放大倍数Auc和共模抑制比KCMR。
![](https://epubservercos.yuewen.com/17AC5F/21122066201628406/epubprivate/OEBPS/Images/69_01.jpg?sign=1739161654-WWAitsSj06I4TInAAb4W7InqTUXSnBap-0-60f479f9198b1ec9e2e1d9d0a4c3817a)
图2-34 差分放大电路对差模信号的抑制
a)电路图 b)差模输入时的交流通路 c)共模输入时的交流通路
解:由图可知,ui1=ui、ui2=0,电路为单端输入,有
![](https://epubservercos.yuewen.com/17AC5F/21122066201628406/epubprivate/OEBPS/Images/69_02.jpg?sign=1739161654-74CEyefGeRzsM7W2Rk8WEJZFDNLTV3dp-0-31af69d8a3f1d6d1ec982d2fc0a66a30)
说明图2-34a所示的单端输入可分解为一对差模信号和一对共模信号
的叠加。
当输入为时,交流通路如图2-34b所示。从VT2漏极输出时的差模电压放大倍数为
![](https://epubservercos.yuewen.com/17AC5F/21122066201628406/epubprivate/OEBPS/Images/69_06.jpg?sign=1739161654-FYieeFRhnzopkK5i9JPpJSbCu5AWVb85-0-4586ff46201609e3ba97a48173f8f0ba)
当输入为时,交流通路如图2-34c所示。从VT2漏极输出时的共模电压放大倍数为
![](https://epubservercos.yuewen.com/17AC5F/21122066201628406/epubprivate/OEBPS/Images/69_08.jpg?sign=1739161654-LQc31yLkG6B8JncJK7aL7ZgpukyURHIs-0-57810393023a2d87ba91558ba5265a8c)
共模抑制比为
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